不止是提速!華爲發布半導體(tǐ)EDA仿真平台基礎設施解決方案
發布時間:2024-05-09

近日,華爲發布面向中(zhōng)小(xiǎo)規模IC(Integrated Circuit,集成電路)設計企業的半導體(tǐ)EDA仿真平台基礎設施解決方案,旨在以高性能高可靠專業存儲、多樣性算力和遠程智能運維服務,助力中(zhōng)小(xiǎo)規模IC設計企業提升EDA仿真業務效率、加快産品上線周期。

IC設計被譽爲人類曆史上最細微最宏大(dà)的工(gōng)程。經數十年演進,先進制程工(gōng)藝已經能夠在不足指甲蓋大(dà)小(xiǎo)的面積上集成千億顆晶體(tǐ)管,這離(lí)不開(kāi)電子設計自動化(Electronic Design Automation)工(gōng)具,即EDA工(gōng)具。
經調研,如今電路設計中(zhōng)65%以上的時間基本都用于仿真。同時,摩爾定律依然有效,伴随晶體(tǐ)管集成度、仿真任務量、設計複雜(zá)程度的日益增長,并迫于一(yī)再壓縮的産品上市周期壓力,半導體(tǐ)企業亟需一(yī)個高效敏捷的EDA仿真平台。
打開(kāi)EDA仿真業務流程可以看到,EDA仿真主要面臨三大(dà)困境:

仿真效率低

EDA仿真主要分(fēn)爲前端業務與後端業務兩個階段。前端業務以RTL編碼仿真爲主,涉及KB級小(xiǎo)文件的元數據讀寫,對存儲的OPS性能有較高訴求。而後端業務以綜合優化仿真、網表編譯測試爲主,主要是GB級别大(dà)文件順序寫,要求存儲提供較高帶寬。目前,業界普遍的存儲産品很難匹配這樣混合型負載的場景。

仿真過程易中(zhōng)斷

仿真業務進入後期,一(yī)次仿真就需要數十小(xiǎo)時。經常遇到temp臨時文件暴增從而爆盤、仿真任務異常重啓從而業務中(zhōng)斷的問題,極易導緻關鍵數據丢失,仿真任務就需要重新開(kāi)始,嚴重影響仿真進程和開(kāi)發周期,這對存儲的可靠性提出更高要求。

缺乏統一(yī)省心的智能運維平台

基礎設施的運維未完全追上設備性能提升的腳步。組網規劃、資(zī)源劃分(fēn)、系統配置、數據遷移等技術工(gōng)作難度較高,大(dà)部分(fēn)中(zhōng)小(xiǎo)企業缺乏自主的部署、規劃與管理能力,因此也面臨着故障響應遲緩、複雜(zá)問題分(fēn)析艱難、故障定界模糊等問題。

爲了解決這些挑戰,華爲數據存儲經過系列化的優化,推出半導體(tǐ)EDA仿真平台基礎設施解決方案,緻力爲中(zhōng)小(xiǎo)規模IC設計企業構建更高效、更省心的基礎設施。
  • 面向仿真生(shēng)産與數據容災,華爲提供OceanStor Dorado 2100全閃存NAS存儲。華爲專門針對EDA場景做了八項優化,海量小(xiǎo)文件以及大(dà)帶寬的讀寫性能都領先業界30%以上,極大(dà)縮短仿真周期。OceanStor Dorado 2100全閃存NAS存儲采用業界NAS唯一(yī)A-A雙活架構,并通過盤級、框級、架構級、解決方案級的四級可靠性設計,實現99.9999%極緻可靠,确保仿真業務不中(zhōng)斷。
  • 同時,面向仿真計算,華爲提供EDA仿真一(yī)體(tǐ)機。EDA前端仿真業務需要大(dà)量的多線程計算,需要多核數處理器計算架構的設備;同時,後端仿真業務會進行時序分(fēn)析、功耗分(fēn)析等單線程計算工(gōng)作,需要單核性能較高的處理器架構的設備。華爲EDA仿真一(yī)體(tǐ)機提供了16~64個多種内核處理器、2~3.1GHz之間多種CPU主頻(pín)的選擇,并支持部分(fēn)算力滿足EDA軟件的安裝。對于中(zhōng)小(xiǎo)規模的IC設計企業,一(yī)台設備即可滿足前後端的仿真需求。
  • 此外(wài),爲了降低中(zhōng)小(xiǎo)規模IC企業的運維難度,華爲提供DME IQ雲端智能管理平台。其彙集了華爲在ICT領域多年積累的知(zhī)識和經驗,通過手機APP即可遠程實時監控設備的運行狀态,并可提前識别硬盤故障、預測設備性能和容量瓶頸,便于及時發現隐患解決,實現主動式運維。同時能夠基于智能化診斷,對性能等問題進行端到端分(fēn)析,實現對問題的快速定界定位。
華爲半導體(tǐ)EDA仿真平台基礎設施解決方案,爲中(zhōng)小(xiǎo)規模IC設計企業打造,旨在以高性能、高可靠、高敏捷的基礎設施,滿足仿真業務端到端的計算、存儲、運維需求,加快半導體(tǐ)行業産品的上線速度。
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